計(jì)算機(jī)硬件技術(shù)基礎(chǔ)

第一章 微型計(jì)算機(jī)系統(tǒng)概論
1.1 微型計(jì)算機(jī)發(fā)展
1.2 微型計(jì)算機(jī)硬件結(jié)構(gòu)
1.3 計(jì)算機(jī)數(shù)的表示
1.3.1 字符二進(jìn)制編碼
1.3.2 數(shù)值的表示
1.4 寄存器
1.4.1 通用寄存器
1.4.2 指令指針寄存器EIP
1.4.3 標(biāo)志寄存器
1.4.4 段寄存器
1.4.5 堆棧
1.5 運(yùn)算器
1.6 控制器
1.6.1 基本功能
1.6.2 控制器的組成
1.7 存儲(chǔ)器
1.7.1 存儲(chǔ)器性能指標(biāo)
1.7.2 半導(dǎo)體存儲(chǔ)器
1.7.3 磁記錄存儲(chǔ)器
1.7.4 光盤存儲(chǔ)器
1.8 I/O設(shè)備
1.8.1 輸入設(shè)備
1.8.2 輸出設(shè)備
1.9 微型機(jī)主要性能指標(biāo)
習(xí)題
第二章 Pentium系統(tǒng)原理
2.1 RISC
2.2 寄存器
2.2.1 通用寄存器
2.2.2 段寄存器
2.2.3 堆棧的實(shí)現(xiàn)
2.2.4 標(biāo)志寄存器
2.2.5 指令指針寄存器
2.2.6 存儲(chǔ)管理寄存器
2.2.7 控制寄存器
2.3 CPU
2.3.1 整數(shù)流水線
2.3.2 浮點(diǎn)流水線
2.3.3 Cache
2.3.4 新型體系結(jié)構(gòu)
2.4 尋址方式
2.4.1 立即操作數(shù)尋址
2.4.2 寄存器操作數(shù)尋址
2.4.3 存儲(chǔ)器操作數(shù)尋址
2.5 數(shù)據(jù)類型
2.6 流水線指令流及分支預(yù)測
2.6.1 流水線操作
2.6.2 指令預(yù)取
2.6.3 指令配對(duì)規(guī)則
習(xí)題
第三章 存儲(chǔ)管理
3.1 綜述
3.1.1 存儲(chǔ)器系統(tǒng)
3.1.2 存儲(chǔ)器結(jié)構(gòu)
3.2 分段存儲(chǔ)管理
3.2.1 平臺(tái)管理方式
3.2.2 保護(hù)方式下的平臺(tái)方式
3.2.3 多段存儲(chǔ)管理方式
3.3 段的轉(zhuǎn)換
3.3.1 段寄存器
3.3.2 段選擇符
3.3.3 段描述符
3.3.4 段描述符表
3.3.5 描述符表基址寄存器
3.4 分頁存儲(chǔ)管理
3.5 頁轉(zhuǎn)換
3.5.1 允許分頁位
3.5.2 線性地址
3.5.3 頁表
3.5.4 頁表項(xiàng)
3.5.5 轉(zhuǎn)換旁視緩沖存儲(chǔ)器ThB
3.6 頁級(jí)保護(hù)
3.7 保護(hù)方式下的多任務(wù)處理
習(xí)題
第四章 高速緩沖存儲(chǔ)器Cache
4.1 Cache存儲(chǔ)器
4.1.1 什么是Cache
4.1.2 Pentium片內(nèi)Cache
4.2 Cache配置方案
4.2.1 Cache大小規(guī)模和性能
4.2.2 練合方式和性能
4.2.3 實(shí)際Cache
4.3 Cache結(jié)構(gòu)
4.3.1 片內(nèi)指令Cache和數(shù)據(jù)Cache
4.4 Cache操作方式
4.4.1 數(shù)據(jù)Cache
4.4.2 數(shù)據(jù)Cache更新方案
4.4.3 指令Cache
4.4.4 Cache讀寫操作
4.4.5 數(shù)據(jù)Cache路徑
4.4.6 Cache替換算法與規(guī)則
4.4.7 Cache寫貫穿
4.4.8 Cache寫回
4.4.9 Cache刷新
4.5 監(jiān)視
4.5.1 監(jiān)視的任務(wù)
4.5.2 監(jiān)視方法
4.5.3 監(jiān)視方式選擇
4.5.4 監(jiān)視操作
4.5.5 監(jiān)視攔阻
4.5 監(jiān)視寫回周期
4.6 一致性協(xié)議
4.6.1 MESI Cache一致性協(xié)議模型
4.6.2 指令Cache一致性協(xié)議
4.6.3 基本MESI狀態(tài)轉(zhuǎn)換
習(xí)題
第五章 浮點(diǎn)部件
5.1 綜述
5.2 浮點(diǎn)部件體系結(jié)構(gòu)
5.2.1 數(shù)值寄存器
5.2.2 狀態(tài)字寄存器
5.2.3 控制字寄存器
5.2.4 標(biāo)記字寄存器
5.2.5 最后的指令操作碼字段
5.2.6 數(shù)值指令和數(shù)據(jù)指針
5.3 浮點(diǎn)流水線操作
5.3.1 浮點(diǎn)指令的流動(dòng)
5.3.2 安全指令的識(shí)別
5.3.3 旁路BYPASSES
5.4 計(jì)算基礎(chǔ)
5.4 數(shù)字系統(tǒng)
5.4.2 數(shù)據(jù)類型和格式
5.4.3 舍入控制
5.4.4 精度控制
5.5 浮點(diǎn)指令
5.5.1 源和目標(biāo)操作數(shù)
5.5.2 數(shù)據(jù)傳送類指令
5.5.3 非超越函數(shù)類指令
5.5.4 比較類指令
5.5.5 超越函數(shù)類指令
5.5.6 常數(shù)指令
5.5.7 控制指令
5.6 浮點(diǎn)部件指令
習(xí)題
第六章 總線
6.1 總線的概念
6.1.1 概念
6.1.2 總線標(biāo)準(zhǔn)的四個(gè)特性
6.1.3 總線分類
6.1.4 總線操作
6.1.5 總線配置結(jié)構(gòu)
6.2 數(shù)據(jù)傳送機(jī)制
6.2.1 實(shí)際存儲(chǔ)器和l/O接口
6.2.2 數(shù)據(jù)傳送機(jī)制
6.2.3 與8位、16位、32位以及64位存儲(chǔ)器的接口
6.3 總線周期
6.3.1 單傳送周期
6.3.2 成組周期
6.3.3 中斷確認(rèn)周期
6.3.4 專用總線周期
6.4 總線狀態(tài)
6.4.1 總線狀態(tài)
6.4.2 總線狀態(tài)轉(zhuǎn)換
6.5 EISA總線
6.5.1 EISA技術(shù)術(shù)語
6.5.2 EISA系統(tǒng)
6.5.3 高性能特征
6.5.4 EISA適配器
6.5.5 EISA總線插槽
6.6 VESA總線
6.6.1 高速圖形適配器
6.6.2 總線頻率和數(shù)據(jù)傳送速率
6.6.3 DMA和中斷
6.6.4 VESA適配器
6.6.5 VESA總線插槽
6.7 PCI總線
6.7.1 PCI局部總線的特征
6.7.2 即插即用（Plug and Play）
6.7.3 PCI接插件
6.7.4 PCI性能
6.7.5 PCI前景
6.7.6 PCI總線操作
6.7.7 總線命令
6.7.8 DMA和中斷
6.7.9 PCI適配器
6.7.10 PCI總線信號(hào)
習(xí)題
第七章 中斷
7.1 中斷的概念
7.1.1 概述
7.1.2 中斷系統(tǒng)
7.2 異常與中斷
7.2.1 中斷源分類
7.2.2 中斷控制器
7.2.3 異常和中斷向量
7.2.4 指令的重新啟動(dòng)
7.3 允許及禁止中斷
7.3.1 不可屏蔽中斷對(duì)未來的不可屏蔽中斷的屏蔽
7.3.2 IF屏蔽INTR
7.3.3 RF對(duì)調(diào)試故障的屏蔽
7.3.4 MOV和POP指令對(duì)堆棧段中某些異常和中斷的屏蔽
7.4 中斷描述符表
7.4.1 異常和中斷同時(shí)存在時(shí)的優(yōu)先級(jí)
7.4.2 中斷描述符表IDT
7.4.3 中斷描述符表內(nèi)描述符
7.5 中斷任務(wù)和中斷過程
7.5.1 中斷過程
7.5.2 中斷任務(wù)
7.6 錯(cuò)誤代碼
7.7 異常條件
7.7.1 中斷——除法錯(cuò)
7.7.2 中斷1——調(diào)試異常
7.7.3 中斷3——斷點(diǎn)
7.7.4 中斷4——溢出
7.7.5 中斷5——邊界檢查
7.7.6 中斷6——無效操作碼
7.7.7 中斷7——設(shè)備不可用
7.7.8 中斷8——雙故障
7.7.9 中斷9（由Intel保留，末使用）
7.7.10 中斷10——無效任務(wù)狀態(tài)段
7.7.11 中斷11——段不存在
7.7.12 中斷12——堆棧異常
7.7.13 中斷13——般保護(hù)
7.7.14 中斷14——頁故障
7.7.15 中斷16——浮點(diǎn)錯(cuò)
7.7.16 中斷17——對(duì)準(zhǔn)檢查
7.8 異常和錯(cuò)誤小結(jié)
習(xí)題
第八章 人機(jī)接口
8.1 顯示接口
8.1.1 CRT顯示系統(tǒng)
8.1.2 LCD顯示及其接口
8.1.3 LED顯示器及其接口
8.2 輸入接口
8.2.1 鍵盤接口
8.2.2 鼠標(biāo)接口
8.2.3 并行打印機(jī)接口
8.2.4 串行通信接口
8.2.5 其他多媒體輸入接口
8.3 存儲(chǔ)器接口
8.3.1 軟盤接口
8.3.2 硬磁盤機(jī)及其接口
8.3.3 光盤接口
8.4 外圍接口芯片
8.4.1 可編程并行接口芯片8255A
8.4.2 可編程定時(shí)／計(jì)數(shù)芯片8253
8.4.3 可編程串行通信接口芯片8250
8.4.4 中斷控制器8259A
8.4.5 DMA控制器8237
8.4.6 多功能接口芯片82380
習(xí)題
第九章 模／數(shù)及數(shù)／模轉(zhuǎn)換
9.1 概述
9.2 D／ A轉(zhuǎn)換。
9.2.1 D／A轉(zhuǎn)換器的基本原理
9.2.2 權(quán)電阻解碼網(wǎng)絡(luò)D／A轉(zhuǎn)換器
9.2.3 T型電阻解碼網(wǎng)絡(luò)D／A轉(zhuǎn)換器
9.3 D／A轉(zhuǎn)換器的主要技術(shù)指標(biāo)
9.3.1 分辨率
9.3.2 線性度
9.3.3 轉(zhuǎn)換精度
9.3.4 建立時(shí)間
9.3.5 溫度系數(shù)
9.3.6 電源抑制比
9.3.7 輸出電子
9.3.8 輸入代碼
9.3.9 輸入數(shù)字電平
9.3.10 工作溫度范圍
9.4 A／D轉(zhuǎn)換器
9.4.1 采樣保持器
9.4.2 A／D轉(zhuǎn)換器的基本原理
9.5 A／D轉(zhuǎn)換器的主要技術(shù)指標(biāo)
9.5.1 分辨率
9.5.2 量化誤差
9.5.3 偏移誤差
9.5.4 滿刻度誤差
9.5.5 絕對(duì)精度
9.5.6 相對(duì)精度
9.5.7 轉(zhuǎn)換速率
9.6 D／A芯片介紹
9.7 A／D芯片介紹
習(xí)題
第十章 匯編語言程序設(shè)計(jì)
10.1 匯編語言基礎(chǔ)
10.1.1 匯編語言概述
10.1.2 指令格式
10.1.3 語句格式
10.2 匯編語言程序結(jié)構(gòu)
10.2.1 源程序結(jié)構(gòu)
10.2.2 偽操作語句
10.2.3 宏操作
10.2.4 過程
10.2.5 宏操作和過程的比較
10.3 匯編程序設(shè)計(jì)
10.3.1 順序結(jié)構(gòu)程序設(shè)計(jì)
10.3.2 分支程序設(shè)計(jì)
10.3.3 循環(huán)程序設(shè)計(jì)
10.3.4 子程序
10.3.5 中斷
10.3.6 發(fā)聲程序
10.4  與高級(jí)語言接口
10.4.1  與BASIC的接口
10.4.2  與C語言的接口
10.4.3  與RORTRAN接口
10.4.4  與PASCAL的接口
習(xí)題