實(shí)用C語言FPGA編程

定　價(jià)：￥38.00

作　者：	（美）佩勒、（美）蒂博
出版社：	機(jī)械工業(yè)出版社
叢編項(xiàng)：	電子與電氣工程叢書
標(biāo)　簽：	電子數(shù)字計(jì)算機(jī)

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ISBN：	9787111211594	出版時(shí)間：	2007-05-01	包裝：	平裝
開本：	0開	頁數(shù)：	269	字?jǐn)?shù)：

內(nèi)容簡介

　　目前用FPGA實(shí)現(xiàn)嵌入式系統(tǒng)呈現(xiàn)越來越最流行的趨勢。本書介紹了用C 語言為FPGA編程的原理和技術(shù)，以及如何用C語言實(shí)現(xiàn)FPGA硬件的平臺。該平臺提供了一個(gè)類似C語言的描述硬件需求的語言Impulse C，設(shè)計(jì)者只需用該語言描述要實(shí)現(xiàn)的硬件的行為，在設(shè)計(jì)平臺的支持下，就可以在FPGA 上實(shí)現(xiàn)所要求的硬件。因此，這種設(shè)計(jì)方法既簡化了硬件設(shè)計(jì)者的設(shè)計(jì)過程，又為軟件設(shè)計(jì)人員提供了一種可行的硬件設(shè)計(jì)的途徑。本書注重理論與實(shí)際相結(jié)合，既有原理的介紹，又對設(shè)計(jì)方法和過程作了詳盡的介紹，同時(shí)提供了豐富的實(shí)例。本書可作為高等院校自動(dòng)化、電子信息類專業(yè)高年級本科生和研究生的教材和學(xué)習(xí)參考資料，也可作為從事FPGA編程的工程技術(shù)人員和EDA工具開發(fā)者的參考書。

作者簡介

暫缺《實(shí)用C語言FPGA編程》作者簡介

圖書目錄

譯者序
序言
前言
致謝
第1章一種計(jì)算平臺——FPGA
1.1 FPGA簡介
1.2 基于FPGA的可編程硬件平臺
1.3 提高性能而降低成本
1.4 工具的作用
1.5 將FPGA作為嵌入式軟件平臺
1.6 編程抽象的重要性
1.7 C語言何時(shí)適用于FPGA設(shè)計(jì)？
1.8 如何使用本書？
第2章可編程平臺的發(fā)展
2.1 可編程邏輯的起源
2.2 可重編程性、硬件描述語言和FPGA的發(fā)展
2.3 可編程片上系統(tǒng)
2.4 FPGA并行計(jì)算
2.5 本章小結(jié)
第3章基于FPGA應(yīng)用的編程模型
3.1 并行處理模型
3.2 FPGA作為并行機(jī)
3.3 并行編程
3.4 通信進(jìn)程編程模型
3.5 Impulse C編程模型
3.6 本章小結(jié)
第4章 Impulse C介紹
4.1 Impulse C的目標(biāo)
4.2 Impulse C編程模型
4.3 一個(gè)最小的Impulse C程序
4.4 進(jìn)程、流、信號和存儲(chǔ)器
4.5 Impulse C中的有符號和無符號數(shù)據(jù)類型
4.6 理解進(jìn)程
4.7 理解流
4.8 使用輸出流
4.9 使用輸入流
4.10 避免流死鎖
4.11 創(chuàng)建和使用信號
4.12 理解寄存器
4.13 使用共享存儲(chǔ)器
4.14 存儲(chǔ)器和流的性能考慮
4.15 本章小結(jié)
第5章描述FIR濾波器
5.1 設(shè)計(jì)概述
5.2 FIR濾波器硬件進(jìn)程
5.3 軟件測試平臺
5.4 桌面仿真
5.5 應(yīng)用監(jiān)控
5.6 本章小結(jié)
第6章生成FPGA硬件
6.1 硬件生成流程
6.2 理解生成的結(jié)構(gòu)
6.3 流和信號接口
6.4 使用HDL仿真來理解流協(xié)議
6.5 調(diào)試生成的硬件
6.6 硬件生成重要事項(xiàng)
6.7 有效利用優(yōu)化器
6.8 硬件進(jìn)程的語言約束
6.9 本章小結(jié)
第7章增加語句級并行
7.1 FPGA計(jì)算模型
7.2 C語言語義和并行
7.3 利用指令級并行
7.4 限制指令級
7.5 循環(huán)展開
7.6 理解流水線
7.7 本章小結(jié)
第8章將已有的C應(yīng)用程序移植到Impulse C
8.1 3-DES算法
8.2 把算法轉(zhuǎn)化成數(shù)據(jù)流模型
8.3 進(jìn)行軟件仿真
8.4 編譯成硬件
8.5 初步硬件分析
8.6 本章小結(jié)
第9章創(chuàng)建嵌入式測試平臺
9.1 一種混合式軟硬件方法
9.2 用嵌入式處理器作為測試生成器
9.3 硬件仿真器的作用
9.4 3-DES算法的硬件測試
9.5 軟件流的宏接口
9.6 構(gòu)建測試系統(tǒng)
9.7 本章小結(jié)
第10章面向FPGA性能優(yōu)化C代碼
10.1 針對性能重新考慮算法
10.2 改進(jìn)1：引入循環(huán)，減小規(guī)模
10.3 改進(jìn)2：數(shù)組拆分
10.4 改進(jìn)3：提高流的性能
10.5 改進(jìn)4：循環(huán)展開
10.6 改進(jìn)5：主循環(huán)流水線化
10.7 本章小結(jié)
第11章描述系統(tǒng)級的并行性
11.1 設(shè)計(jì)概要
11.2 執(zhí)行桌面仿真
11.3 改進(jìn)1：創(chuàng)建8位并行濾波器
11.4 改進(jìn)2：創(chuàng)建一個(gè)系統(tǒng)級的流水線
11.5 將應(yīng)用移至硬件
11.6 本章小結(jié)
第12章將Impulse C與嵌入式操作系統(tǒng)相結(jié)合
12.1 μClinux操作系統(tǒng)
12.2 一個(gè)μClinux演示項(xiàng)目
12.3 本章小結(jié)
第13章 Mandelbrot圖像生成
13.1 設(shè)計(jì)概述
13.2 用C語言描述算法
13.3 創(chuàng)建定點(diǎn)數(shù)等價(jià)算法
13.4 創(chuàng)建一個(gè)流版本
13.5 算法并行化
13.6 未來的優(yōu)化
13.7 本章小結(jié)
第14章 FPGA計(jì)算的未來
14.1 FPGA作為高性能計(jì)算機(jī)
14.2 FPGA計(jì)算的未來
14.3 本章小結(jié)
附錄A 獲取嵌入式FPGA處理器最大限度的輸出
附錄B 生成定制流接口
附錄C Impulse C函數(shù)參考
附錄D 3-DES源代碼清單
附錄E 圖像濾波器清單
附錄F 部分參考文獻(xiàn)
索引