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FPGA/CPLD應用設計200例(下冊)

FPGA/CPLD應用設計200例(下冊)

定 價:¥72.00

作 者: 張洪潤,張亞凡 主編
出版社: 北京航空航天大學出版社
叢編項: 實用工程技術叢書
標 簽: 維修

ISBN: 9787811243161 出版時間: 2009-01-01 包裝: 平裝
開本: 16開 頁數(shù): 661 字數(shù):  

內(nèi)容簡介

  本書是《實用工程技術叢書》之一,是應廣大科學研究人員、工程技術人員的迫切需求,參照國內(nèi)外1000余項FPGA/CPLD應用設計成果,從實用角度出發(fā)編寫的。其特點是所編內(nèi)容新穎、齊全,分類規(guī)范,使用方便、快捷,是一本具有實用性、啟發(fā)性、信息性的綜合工具書。全書分上、下兩冊。上冊主要介紹FPGA/CPLD可編程控制器在網(wǎng)絡通信、儀器儀表、工業(yè)控制、遙感遙測、汽車工業(yè)、航天軍工及家用電器等領域的典型應用設計實例;下冊主要介紹產(chǎn)品設計開發(fā)技巧、方法與秘訣,常用設計、開發(fā)工具及軟件特性,常用芯片的結(jié)構(gòu)特點等內(nèi)容。全書共計典型應用設計實例287個。本書適用于科學研究人員、工程技術人員、維護修理人員及大專院校師生。

作者簡介

暫缺《FPGA/CPLD應用設計200例(下冊)》作者簡介

圖書目錄

第2篇 FPGA/CPLD產(chǎn)品設計、開發(fā)技巧與秘訣
2.1 如何根據(jù)項目選擇器件
2.2 可編程器件的選擇原則
2.3 確定初步方案的方法與技巧
2.4 基于可編程邏輯器件的數(shù)字系統(tǒng)的設計流程
2.5 掌握常用FPGA/CPLD
2.6 EDA技術的基本設計方法
2.7 數(shù)字系統(tǒng)設計中的低功耗設計方法
2.8 動態(tài)可編程重構(gòu)技術
2.9 多級邏輯的設計技巧
2.10 Verilog HDL設計方法與技巧
2.11 FPGA設計的穩(wěn)定性探討
2.12 同步電路設計技巧
2.13 圖形設計法的實用技術
2.14 狀態(tài)機設計技巧
2.15 存儲器的VHDL實現(xiàn)方法與技巧
2.16 存儲器設計典型實例
2.17 只讀存儲器
2.18 比較器
2.19 多路選擇器
2.20 三態(tài)總線
2.21 m序列的產(chǎn)生和性質(zhì)
2.22 對具體某一信號的連續(xù)存儲
2.23 典型的時序邏輯電路分析與描述
2.24 用Verilog HDL的時序邏輯電路設計
2.25 時序邏輯電路的設計方法與技巧
2.26 FPGA/CPLD的設計和優(yōu)化
2.27 CPLD典型器件ispPAC20的擴展應用技巧
2.28 CPLD典型器件ispPAC的基本應用技巧
2.29 Verilog HDL設計組合邏輯電路技巧
2.30 VHDL設計組合邏輯電路技巧
2.31 LED七段譯碼器的分析與設計
2.32 電路的仿真技巧
2.33 宏器件及其調(diào)用
2.34 ispPAC的增益調(diào)整方法
2.35 數(shù)字系統(tǒng)的描述方法
2.36 FPGA系統(tǒng)設計與調(diào)試技巧
2.37 典型的下載/配置方式
2.38 Xilinx器件的下載
2.39 ByteBlaster并口下載電纜
2.40 單個FLEX系列器件的PS配置(下載電纜連接與下載操作)
2.41 多個FLEX器件的PS配置(下載電路連接與下載操作)
2.42 單個MAX器件的JTAG方式編程(POF文件連接與編程)
2.43 單個FLEX器件的JTAG方式配置(SOF文件連接與編程)
2.44 多個MAX/FLEX器件的JTAG方式編程/配置(連接與編程)
2.45 主動串行與被動串行配置模式
2.46 門禁系統(tǒng)設計技巧
2.47 兩種實際應用的計數(shù)器電路設計
2.48 常用觸發(fā)器及其應用設計技巧
2.49 加法器設計
2.50 ispPAC的接口電路設計
2.51 編程接口和編程——ISP方式和JTAG方式
2.52 利用Verilog HDL設計狀態(tài)機的技巧
2.53 系統(tǒng)級層次式設計
2.54 邊界掃描測試技術
2.55 在系統(tǒng)下載電纜與評估板
2.56 用CPLD和單片機設計電子系統(tǒng)
2.57 怎樣優(yōu)化程序
2.58 怎樣才能避免潛在的危險
2.59 毛刺的產(chǎn)生及其消除技巧
2.60 計數(shù)器設計與FPGA資源
2.61 組合邏輯電路的競爭冒險及其消除技巧
2.62 選擇器設計和FPGA資源
2.63 基于FPGA/CPLD應用設計的23點經(jīng)驗總結(jié)
第3篇 FPGA/CPLD常用工具及軟件特性
3.1 常用的FPGA開發(fā)工具
3.2 常用EDA設計工具
3.3 FPGA/CPLD數(shù)字邏輯實驗平臺
3.4 軟件資源
3.5 典型常用的Verilog HDL語言(應用設計舉例)
3.6 Verilog HDL的一般結(jié)構(gòu)
3.7 19種常用電路的Verilog HDL描述
3.8 典型常用的VHDL語言(應用設計舉例)
3.9 10種常用電路的VHDL描述
第4篇 FPGA/CPLD常用芯片結(jié)構(gòu)及特點
4.1 FPGA和CPLD的結(jié)構(gòu)性能對照
4.2 FPGA/CPLD的基本結(jié)構(gòu)和原理
4.3 Xilinx系列CPLD
4.4 Altera系列CPLD
4.5 現(xiàn)場可編程系統(tǒng)芯片F(xiàn)PSC
4.6 無限可重構(gòu)可編程門陣列ispXPGA
4.7 ispXPLD器件
4.8 在系統(tǒng)可編程通用數(shù)字開關ispGDS和互連器件ispGDX/V
4.9 在系統(tǒng)可編程模擬器件的原理
4.10 各種在系統(tǒng)可編程模擬器件的結(jié)構(gòu)
4.11 ispLSI系列器件的性能參數(shù)
4.12 ispLSI系列器件的主要技術特性
4.13 ispLSI系列器件的編程方法
4.14 成熟器件與新型器件
4.15 FPGA/CPLD器件的編程
附錄1 現(xiàn)場可編程邏輯器件主流產(chǎn)品一覽
附錄2 各種器件的下載電路(在系統(tǒng)可編程ispJTAGTM芯片設計指導)
附錄3 Lattice系統(tǒng)宏(器件庫)
附錄4 國內(nèi)外常用二進制邏輯元件圖形符號對照表
附錄5 世界著名的FPGA廠商及商標符號
附錄6 實驗開發(fā)板電路原理圖
附錄7 常用FPGA的端口資源
附錄8 兩種CPLD實驗儀器面板圖及電路圖
附錄9 CPLD主要器件引腳圖
附錄10 縮略語詞匯表
參考文獻

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