電子設(shè)計(jì)自動(dòng)化技術(shù)實(shí)踐

定　價(jià)：￥59.00

作　者：	謝小東編
出版社：	科學(xué)出版社
叢編項(xiàng)：	電子科學(xué)與技術(shù)專業(yè)實(shí)驗(yàn)教材系列叢書，電子信息材料與器件系列規(guī)劃教材
標(biāo)　簽：	暫缺

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京東 (￥42.00)

ISBN：	9787030611635	出版時(shí)間：	2020-06-01	包裝：	平裝
開本：	16開	頁數(shù)：	249	字?jǐn)?shù)：

內(nèi)容簡(jiǎn)介

　　《電子設(shè)計(jì)自動(dòng)化技術(shù)實(shí)踐/電子科學(xué)與技術(shù)專業(yè)實(shí)驗(yàn)教材系列叢書，電子信息材料與器件系列規(guī)劃教材》相較于市面上其他同類教材，在內(nèi)容上有兩個(gè)特點(diǎn)：系統(tǒng)介紹了電子設(shè)計(jì)自動(dòng)化技術(shù)實(shí)現(xiàn)的硬件平臺(tái)原理，即FPGA原理和FPGA開發(fā)平臺(tái)原理;按照學(xué)生對(duì)電子設(shè)計(jì)自動(dòng)化技術(shù)的自然認(rèn)知順序安排章節(jié)內(nèi)容。從電子設(shè)計(jì)自動(dòng)化技術(shù)的方法、流程開始，繼而講述實(shí)現(xiàn)電子設(shè)計(jì)自動(dòng)化技術(shù)的硬件原理、軟件流程、硬件描述語言（工具），并與時(shí)俱進(jìn)地加入了常見的IP應(yīng)用，然后按照由淺入深的順序，安排了基礎(chǔ)實(shí)驗(yàn)案例，系統(tǒng)實(shí)驗(yàn)案例，最后講述設(shè)計(jì)進(jìn)階技術(shù)，提升讀者的設(shè)計(jì)水平。該書的實(shí)驗(yàn)案例均為課程組在教學(xué)中采用的案例，對(duì)讀者的綜合設(shè)計(jì)能力能起到很好的訓(xùn)練作用。《電子設(shè)計(jì)自動(dòng)化技術(shù)實(shí)踐/電子科學(xué)與技術(shù)專業(yè)實(shí)驗(yàn)教材系列叢書，電子信息材料與器件系列規(guī)劃教材》適用于電子科學(xué)與技術(shù)，特別是微電子科學(xué)與工程、微電子學(xué)、集成電路與集成系統(tǒng)等專業(yè)的師生使用。

作者簡(jiǎn)介

暫缺《電子設(shè)計(jì)自動(dòng)化技術(shù)實(shí)踐》作者簡(jiǎn)介

圖書目錄

第1章緒論
1．1 專用集成電路與可編程邏輯器件
1．1．1 專用集成電路的特點(diǎn)
1．1．2 可編程邏輯器件的特點(diǎn)
1．2 TOP-DOWN設(shè)計(jì)
1．3 本書的主要結(jié)構(gòu)
第2章 FPGA介紹
2．1 FPGA基本結(jié)構(gòu)
2．2 FPGA基本原理
2．3 FPGA的應(yīng)用
2．4 FPGA基本特點(diǎn)
2．5 FPGA芯片介紹
2．5．1 Xilinx FPGA
2．5．2 Altera FPGA
第3章 FPGA硬件實(shí)驗(yàn)平臺(tái)
3．1 EDA實(shí)驗(yàn)開發(fā)板概述
3．1．1 核心板資源
3．1．2 核心板實(shí)物圖
3．1．3 擴(kuò)展底板資源
3．1．4 擴(kuò)展底板實(shí)物圖
3．2 實(shí)驗(yàn)平臺(tái)基本功能塊
3．2．1 PROM配置電路
3．2．2 電源電路
3．2．3 I2C串行EEPROM AT24C08
3．2．4 時(shí)鐘和復(fù)位電路
3．2．5 數(shù)碼管顯示模塊
3．2．6 LED顯示模塊
3．2．7 撥碼開關(guān)
3．2．8 獨(dú)立按鍵
3．2．9 蜂鳴器驅(qū)動(dòng)模塊
3．2．10 有源晶振模塊
3．2．11 溫度傳感器電路
3．2．12 串行DA、AD電路
3．2．13 RS232接口模塊
3．2．14 JTAG接口
3．2．15 VGA接口電路
3．2．16 PS/2鍵盤、鼠標(biāo)接口
3．2．17 液晶1602與12864顯示接口電路
3．2．18 I/O資源
3．2．19 實(shí)時(shí)時(shí)鐘電路
第4章 EDA開發(fā)設(shè)計(jì)流程
4．1 ISE軟件的使用
4．1．1 啟動(dòng)ISE
4．1．2 創(chuàng)建項(xiàng)目工程（Project）
4．1．3 功能仿真
4．1．4 原理圖仿真
4．1．5 綜合（Synthesize）
4．1．6 用戶約束（User Constraints）——定義輸入輸出管腳約束
4．1．7 設(shè)計(jì)實(shí)現(xiàn)（Implement Design）
4．1．8 下載配置
……