低功耗片上網(wǎng)絡

定　價：￥168.00

作　者：	[意] 克里斯蒂娜·西爾瓦諾（Cristina Silvano）著，[意] 克里斯蒂娜·西爾瓦諾，[美] 馬塞洛·拉約洛，[意] 詹盧卡·巴勒莫編，許川佩，胡聰，朱愛軍，張龍，黃喜軍 ... 譯
出版社：	國防工業(yè)出版社
叢編項：	高新科技譯叢
標　簽：	暫缺

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ISBN：	9787118125238	出版時間：	2022-08-01	包裝：	精裝
開本：	16開	頁數(shù)：	230	字數(shù)：

內容簡介

　　在片上網(wǎng)絡中，功耗是衡量其性能的重要參數(shù)之一，由于片上面積、散熱能力等因素的限制，芯片的設計重點已不單單關注高性能，低功耗芯片的設計更加引人重視。雖然高性能能夠滿足人們的需求，但是過高的功耗必然對系統(tǒng)的可靠性和散熱能力造成一定的影響。本書從底層設計技術、系統(tǒng)級設計技術和未來新興技術三個方面闡述了低功耗NoC技術。

作者簡介

　　克里斯蒂娜·西爾瓦諾（Cristina Silvano），1987年于意大利米蘭理工大學獲得電子工程碩士學位，1999年于意大利布雷西亞大學獲得計算機工程博士學位。1987-1996年，任意大利普雷尼亞納Groupe Bull公司研發(fā)實驗室的高級工程師。2000-2002年，任米蘭大學計算機科學系助理教授，現(xiàn)為米蘭大學生物工程與電子信息計算機工程專業(yè)的副教授，出版了一本國際科學著作，并在國際期刊和會議上發(fā)表了70多篇論文，同時還擁有多項國際專利。她的主要研究領域是數(shù)字系統(tǒng)計算機架構和計算機輔助設計，主要集中在多處理器系統(tǒng)芯片的設計空間探索和低功耗設計技術。她參與了多項國家和國際研究項目，其中一些是與意法半導體公司進行合作，還是FP7-2PARMA-248716項目的歐洲協(xié)調員，該項目為關于“多核架構的并行擴展和運行時管理技術”（2010年1月一2012年12月）；她也是“關于嵌入式多媒體應用多處理器SoC架構的多目標設計空間探索”（2008年1月-2010年6月）正在進行的FP7-MULTICUBE-216693項目的歐洲協(xié)調員。

圖書目錄

第一部分底層設計技術
第1章基于高效片上互連技術的混合電路/包交換網(wǎng)絡
1.1 片上網(wǎng)絡的過去、現(xiàn)在和未來
1.1.1 片上網(wǎng)絡的發(fā)展現(xiàn)狀
1.1.2 未來面對的問題及挑戰(zhàn)
1.2 混合包/電路交換片上網(wǎng)絡的提出
1.2.1 具有包交換仲裁機制的NoC電路交換數(shù)據(jù)
1.2.2 電路/包交換網(wǎng)絡仲裁的電路創(chuàng)新
1.2.3 數(shù)據(jù)傳輸電路的創(chuàng)新
1.3 在45nm工藝下片上網(wǎng)絡的測試與權衡
1.4 小結
參考文獻
第2章低功耗片上網(wǎng)絡的運行時門控電源技術
2.1 引言
2.2 片上虛通道路由器
2.2.1 目標路由器體系結構
2.2.2 目標路由器結構的功耗分析
2.3 低功耗技術的前期工作
2.3.1 電壓和頻率調節(jié)技術
2.3.2 門控電源技術
2.4 細粒度門控電源路由器
2.4.1 電源域劃分
2.4.2 電源域實現(xiàn)
2.4.3 喚醒時延估計
2.5 喚醒控制的方法
2.5.1 喚醒時延的影響
2.5.2 前瞻性方法
2.5.3 持續(xù)運行的前瞻性方法
2.5.4 帶有活動緩沖器窗口的前瞻性方法
2.6 實驗評估
2.6.1 模擬環(huán)境
2.6.2 性能影響
2.6.3 泄漏功耗的降低
2.7 小結
參考文獻
第3章高能效片上網(wǎng)絡鏈路的自適應電壓控制
3.1 引言（概述）
3.2 提高片上鏈路能效的方法
3.2.1 能效指標
3.2.2 數(shù)據(jù)鏈路層技術
3.2.3 物理層技術
3.2.4 其他方法
3.3 超前——基于過渡轉換感知鏈路的電壓控制
3.3.1 超前變送器設計
3.3.2 HI/LO電壓選擇
3.3.3 性能評估
3.3.4 局限性
參考文獻
第4章片上網(wǎng)絡異步通信
4.1 引言
4.1.1 可變性
4.1.2 功耗
4.1.3 本章結構
4.2 在片上網(wǎng)絡時代之前的異步通信發(fā)展史
4.3 基于令牌觀的通信
4.4 異步信令傳輸基礎
4.4.1 信令技術
4.4.2 握手協(xié)議
4.4.3 信道類型
4.5 延遲不敏感數(shù)據(jù)傳輸
4.5.1 雙軌
4.5.21 /N和M/N編碼
4.5.3 單轉換編碼
4.6 延遲敏感通信
4.6.1 捆綁式數(shù)據(jù)編碼
4.6.2 單軌信令
4.6.3 基于脈沖的信令
4.7 SEU彈性編碼
4.7.1 相位編碼
4.7.2 數(shù)據(jù)參考碼
4.7.3 編碼小結
4.8 流水線技術
4.8.1 配對握手
4.8.2 串行與并行鏈路
4.9 片上網(wǎng)絡
4.10 同步器
4.11 路由器
4.12 CAD問題
4.12.1 邏輯綜合
4.12.2 語法驅動設計
4.12.3 采用Petrify綜合的舉例
4.13 小結
參考文獻
第二部分系統(tǒng)級設計技術
第5章低功耗片上網(wǎng)絡設計中面向應用的路由算法
5.1 引言
5.2 路由算法和功耗的背景
5.2.1 路由算法的分類
5.2.2 蟲洞交換和死鎖
5.2.3 路由算法的基本要素
5.2.4 路由邏輯和硬件影響
5.2.5 NoC中區(qū)域的概念
5.2.6 網(wǎng)絡能量和路由算法
5.2.7 常見性能指標
5.3 術語和定義
5.3.1 基本定義
5.3.2 通道依賴圖和無死鎖
5.3.3 面向應用的通道依賴圖
5.3.4 自適應路由
5.4 APSRA設計方法
5.4.1 APSRA舉例
5.4.2 主要算法
5.4.3 自適應最小損耗的阻斷沿
5.4.4 路由表
5.5 APSRA的性能評估
5.5.1 流量情況
5.5.2 自適應性分析
5.5.3 仿真評估
5.6 成本、功耗和能耗分析
5.6.1 常用的路由器結構
5.6.2 面積和功耗
5.6.3 能耗
5.7 小結
參考文獻
第6章低功耗片上網(wǎng)絡的自適應數(shù)據(jù)壓縮
6.1 引言
6.2 相關工作
6.3 片上網(wǎng)絡上的數(shù)據(jù)壓縮
6.3.1 片上網(wǎng)絡體系結構
6.3.2 壓縮支持
6.3.3 表組織
6.4 優(yōu)化壓縮
6.4.1 共享表結構
6.4.2 共享表一致性管理
6.4.3 提高壓縮效率
6.5 方法
6.6 實驗結果
6.6.1 可壓縮性和數(shù)值的分析模型
6.6.2 功耗的影響
6.6.3 數(shù)據(jù)包延遲的影響
6.6.4 壓縮表面積分析
6.6.5 寬/長的-通道網(wǎng)絡的比較
6.7 小結
參考文獻
第7章 4G SoC延遲約束、功率優(yōu)化的NoC設計：案例研究
7.1 引言
7.2 相關工作
7.3 目標應用程序
7.4 NoC設計與優(yōu)化
7.4.1 成本優(yōu)化映射
7.4.2 設置鏈路容量
7.5 實驗結果
7.5.1 目標路由器的體系架構
7.5.2 綜合結果
7.6 小結
參考文獻
第三部分未來和新興技術
第8章低功耗2D和3DSoC的片上網(wǎng)絡的設計與分析
8.1 引言
8.2 電